AD9166BBPZ 是高性能、寬帶、片內(nèi)矢量信號發(fā)生器，由高速 JESD204B 串行器/解串器（SERDES）接口、靈活的 16 位數(shù)字?jǐn)?shù)據(jù)路徑、正交 (IQ) 數(shù)模轉(zhuǎn)換器 (DAC) 內(nèi)核以及一個集成的差分至單端輸出緩沖放大器組成 ，可匹配高達(dá) 10 GHz 的 50 Ω 負(fù)載。

DAC 內(nèi)核基于四開關(guān)架構(gòu)，可改變配置提高 DAC 內(nèi)核的有效更新速率，從 6.4 GHz DAC 采樣時鐘配置為高達(dá) 12.8 GSPS，模擬輸出帶寬通常為直流至 9.0 GHz。數(shù)字?jǐn)?shù)據(jù)路徑包括多個插值濾波器級，具有支持快速跳頻 (FFH) 的多個數(shù)控振蕩器 (NCO) 的直接數(shù)字頻率合成器 (DDS) 塊，以及額外的 FIR85 和反 Sinc 濾波器級，以實(shí)現(xiàn)靈活的頻譜規(guī)劃。

與單端緩沖器的差分消除了對寬帶巴倫的需求，并支持 DAC 內(nèi)核的全部模擬輸出帶寬。直流耦合輸出可以基帶波形，而無需外部偏置三通或類似電路，這使得 AD9166BBPZ 特別適合應(yīng)用在最苛刻的高速超寬帶 RF 發(fā)射。

各種濾波器級使 AD9166BBPZ 可以配置為較低的數(shù)據(jù)速率，同時保持較高的 DAC 時鐘速率，以簡化濾波要求并減小整體系統(tǒng)尺寸，重量和功耗。

數(shù)據(jù)接口接收器包含多達(dá) 8 個 JESD204B SERDES 通道，每個通道可承載 12.5 Gbps。為了實(shí)現(xiàn)較大的靈活性，可以根據(jù)數(shù)據(jù)速率、SERDES 通道數(shù)量和 JESD204B 變送器所需的通道映射對接收器進(jìn)行全面配置。

在 2x 非歸零 (NRZ) 工作模式（啟用 FIR85）下，AD9166 可以將RF載波從真實(shí)直流重構(gòu)到第三個奈奎斯特區(qū)的邊緣，或者重建高達(dá) 9 GHz 的真實(shí)直流的模擬帶寬。

在混合模式下，AD9166BBPZ 可以在第二和第三奈奎斯特區(qū)域重構(gòu) RF 載波，同時消耗較低的功率，并保持與 2×NRZ 模式相當(dāng)?shù)男阅堋?/span>

在基帶模式下，例如歸零 (RZ) 和 1x NRZ，AD9166BBPZ 非常適合將 RF 載波從真實(shí)直流重構(gòu)到第一個奈奎斯特區(qū)的邊緣，同時與 2x NRZ 模式相比功耗更低。

正交 DDS 塊可以配置為數(shù)字上變頻器，以將 I/Q 數(shù)據(jù)采樣上變頻到頻譜中所有三個奈奎斯特區(qū)域中的所需位置。

DDS 還包括一組 32 個數(shù)控振蕩器（NCO），每個振蕩器都有各自的 32 位相位累加器。當(dāng)與100 MHz 串行外圍接口 (SPI) 結(jié)合使用時，DDS 允許相位相干 FFH，相位建立時間低至 300 ns。

AD9166BBPZ 使用公共 SPI 接口配置，該接口監(jiān)測所有寄存器狀態(tài)。AD9166 采用 324 引腳，15 mm × 15 mm，0.8 mm 間距 BGA_ED 封裝。

AD9166BBPZ 應(yīng)用

儀器儀表：自動化測試設(shè)備，電子測試和測量，任意波形發(fā)生器

電子戰(zhàn)：雷達(dá)和干擾器

寬帶通信系統(tǒng)

本地振蕩器驅(qū)動器

AD9166BBPZ 特性

直流耦合、50Ω 匹配輸出

高達(dá) 4.3 dBm 的輸出功率，9 GHz 時為 -9.5 dBm

DAC 內(nèi)核更新率：2×NRZ 模式下為 12.0 GSPS（保證的最小值）

寬模擬帶寬

2×NRZ 模式下，直流至 9.0 GHz（12.0 GSPS DAC 更新速率）

在混合模式下，1.0 GHz 至 8.0 GHz（6.0 GSPS DAC 更新速率）

在 NRZ 模式下，直流至 4.5 GHz（6.0 GSPS DAC 更新速率）

2×NRZ 模式下的功耗為 4.88 W（10 GSPS DAC 更新速率）

旁路數(shù)據(jù)路徑插值

2×, 3×, 4×, 6×, 8×, 12×, 16×, 24×

瞬時（復(fù)雜）信號帶寬

設(shè)備時鐘為 5 GHz 時為 2.25 GHz（ 2 倍插值）

設(shè)備時鐘為 6 GHz 時為 1.8 GHz（ 3 倍插值）

快速跳頻

集成 biCMOS 緩沖區(qū)放大器

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